x86匯編語言:編寫64位多處理器多線程操作系統

李忠,王曉波,李雙圓

  • 出版商: 電子工業
  • 出版日期: 2024-06-01
  • 售價: $768
  • 貴賓價: 9.5$730
  • 語言: 簡體中文
  • 頁數: 536
  • ISBN: 7121479087
  • ISBN-13: 9787121479083
  • 相關分類: Operating-system
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商品描述

編寫一個簡單的、簡易的操作系統雛形,用來演示64位環境下的多處理器管理、動態內存分配、多處理器多任務的調度和切換、多處理器多線程的調度和切換、數據競爭和鎖,但它不包括文件管理、設備管理等內容。本書主要聚焦以下問題:1,與IA-32架構進行對比,介紹64位處理器的基本架構,包括寄存器的變化、指令集和工作模式的變化、系統表的變化、內存組織和內存訪問模式的變化;2,IA-32e模式的特點及如何進入IA-32e模式,重點介紹其64位子模式;3,IA-32e模式的4級和5級分頁;4,IA-32e模式下的中斷和異常處理;5,64位模式下的單處理器多任務和任務切換;6,64位模式下的多處理器管理和初始化,包括高級可編程中斷控制器APIC;7,64位模式下的多處理器多任務和任務切換;8,64位模式下的多處理器多線程和線程切換;9,高速緩存及與多線程有關的原子操作、鎖、線程同步,等等。

目錄大綱

目 錄
第1章 基本要求和相關說明 1
1.1 配書代碼和工具 1
1.2 NASM的下載和安裝 1
1.3 NASMIDE的下載和使用 3
1.4 下載和安裝VirtualBox 7
1.5 使用FixVhdWr將程序寫入虛擬硬盤 8
1.6 本書的代碼組織 10
第2章 x64架構的基本執行環境 37
2.1 x64架構的由來 37
2.2 物理地址、有效地址和線性地址 39
2.3 x64架構的工作模式 40
2.3.1 x86處理器的工作模式 40
2.3.2 IA-32e模式及其子模式 41
2.4 x64架構的寄存器 43
2.4.1 x64架構對通用寄存器的擴展 43
2.4.2 x64架構的通用寄存器訪問規則 45
2.5 x86處理器的物理地址空間 46
2.6 傳統模式的內存訪問 47
2.6.1 傳統模式下的線性地址和物理地址 47
2.6.2 傳統模式下的32位4KB分頁技術 48
2.6.3 傳統模式下如何利用超過4GB的物理內存 49
2.6.4 傳統模式下的32位4MB分頁技術 50
2.6.5 傳統模式下的32位PAE分頁技術 52
2.6.6 傳統模式下的32位PAE-4KB分頁技術 52
2.6.7 傳統模式下的32位PAE-2MB分頁技術 54
2.7 IA-32e模式的內存訪問 56
2.7.1 x64架構的線性地址空間 56
2.7.2 擴高(Canonical)地址 57
2.7.3 擴高地址的特點和處理器檢查 58
2.7.4 兼容模式的內存訪問 59
2.7.5 64位模式的內存訪問 60
2.7.6 x64架構的段寄存器 60
2.7.7 x64架構的代碼段描述符 61
2.7.8 x64架構的數據段描述符 62
2.7.9 x64架構的4級和5級分頁 63
2.8 x64架構的系統表和系統描述符 65
2.8.1 x64架構的GDTR 65
2.8.2 x64架構的IDTR 66
2.8.3 x64架構的LDT描述符和LDTR 67
2.8.4 x64架構的TSS描述符和TR 68
2.9 x64架構的標志寄存器和指令指針寄存器 69
2.10 x64架構的尋址方式 71
2.10.1 x64架構下傳統模式的尋址方式 71
2.10.2 x64架構下IA-32e模式的尋址方式 72
2.10.3 64位模式的RIP相對尋址方式 73
2.10.4 64位模式下的指令變化情況 75
2.11 IA-32e模式下的中斷和異常處理概述 77
第3章 進入IA-32e模式 79
3.1 如何進入IA-32e模式 79
3.2 本章代碼清單 81
3.3 執行主引導程序 101
3.3.1 NASM的文件包含 101
3.3.2 主引導程序的說明 102
3.3.3 用BIOS硬盤擴展讀加載內核加載器 103
3.3.4 通過數據段訪問棧中的數據結構 106
3.3.5 讀取內核加載器程序的剩餘部分 107
3.3.6 轉入內核加載器執行 109
3.4 執行內核加載器 110
3.4.1 檢測處理器是否支持IA-32e模式 110
3.4.2 位測試指令BT 111
3.4.3 獲取處理器的商標和地址尺寸 111
3.5 進入保護模式 115
3.6 加載內核程序 118
3.7 為進入IA-32e模式準備4級分頁 121
3.7.1 2MB和1GB頁面的4級分頁方式 122
3.7.2 4級頭表的格式 123
3.7.3 頁目錄指針項的格式 125
3.7.4 頁目錄項和頁表項的格式 127
3.7.5 4級頭表的創建和初始化 129
3.7.6 創建指向4級頭表自身的4級頭表項 129
3.7.7 準備映射物理內存的低端2MB空間 130
3.7.8 創建與低端2MB物理內存對應的分頁系統表項 132
3.7.9 將物理內存低端的2MB映射到線性地址空間的高端 134
3.7.10 為多任務環境準備必要的4級頭表項 136
3.7.11 為多任務環境預分配254個頁目錄指針表 137
3.7.12 進程上下文標識PCID 139
3.7.13 控制寄存器CR3的內容格式 140
3.7.14 設置控制寄存器CR3並開啟物理地址擴展功能 141
3.7.15 型號專屬寄存器IA32_EFER的設置和分頁的開啟 142
3.8 進入IA-32e的兼容模式執行 143
3.9 進入64位模式的內核執行 144
3.10 讓內核工作在線性地址空間的高端 145
3.10.1 啟用GDT和棧區的高端線性地址 146
3.10.2 使用RIP相對尋址方式計算內核的高端線性地址 147
3.10.3 讓處理器轉到內核程序對應的高端位置繼續執行 148
3.11 初始化IA-32e模式下的中斷系統 149
3.11.1 IA-32e模式下的中斷門和陷阱門 149
3.11.2 IA-32e模式下的中斷處理過程 151
3.11.3 通用的中斷和異常處理策略 152
3.11.4 通用異常服務例程的工作過程 152
3.11.5 加載有效地址指令LEA 155
3.11.6 創建通用異常處理過程的中斷門 156
3.11.7 安裝通用異常處理過程的中斷門 157
3.11.8 安裝通用中斷處理過程的中斷門 159
3.11.9 初始化8259中斷控制器 159
3.11.10 打印64位模式下的第一條信息 160
3.12 本章代碼的編譯和運行 162
第4章 單處理器環境下的多任務管理和調度 164
4.1 本章代碼清單 165
4.2 初始化快速系統調用環境 182
4.2.1 快速系統調用的原理 182
4.2.2 為快速系統調用安裝段描述符 184
4.2.3 為快速系統調用準備段選擇子 186
4.2.4 設置快速系統調用的入口點 187
4.2.5 快速系統調用時的RFLAGS和棧切換 188
4.3 動態內存分配 189
4.3.1 內核空間的分配策略 189
4.3.2 內核可用線性地址的獲取和更新 190
4.3.3 立即數在64位模式下的長度限制 192
4.3.4 計算本次內存分配涉及的線性地址範圍 193
4.3.5 獲取與指定線性地址對應的4級頭表項的線性地址 193
4.3.6 頁面分配與頁映射位串 196
4.3.7 頁映射位串的定義和空閑頁的查找 197
4.3.8 獲取與指定線性地址對應的頁目錄指針項的線性地址 199
4.3.9 檢查與指定線性地址對應的頁目錄指針項是否存在 201
4.3.10 分配頁目錄表並安裝與線性地址對應的頁目錄指針項 201
4.3.11 安裝與指定線性地址對應的頁目錄項、頁表項和頁面 202
4.4 創建並安裝TSS描述符 203
4.4.1 LDT和TSS描述符的格式 204
4.4.2 創建和安裝64位的TSS描述符並加載任務寄存器TR 205
4.5 初始化實時時鐘中斷 206
4.6 創建外殼任務 207
4.6.1 準備創建外殼任務 207
4.6.2 為新任務創建任務控制塊PCB 208
4.6.3 為新任務創建4級頭表 209
4.6.4 將指定的線性地址映射到指定的物理頁 211
4.6.5 復制當前活動4級頭表的內容給新任務的4級頭表 212
4.6.6 切換到新任務的地址空間並清空4級頭表的前半部分 212
4.6.7 為新任務分配0特權級使用的棧空間 213
4.6.8 為新任務分配3特權級使用的棧空間 214
4.6.9 從硬盤上加載用戶程序 215
4.6.10 生成任務標識 216
4.6.11 將新任務的PCB添加到PCB鏈表 217
4.6.12 設置外殼任務的狀態 220
4.7 設置任務狀態段TSS 220
4.8 轉到外殼任務的局部空間執行 221
4.9 快速系統調用的進入和返回 222
4.9.1 為快速系統調用指定功能號 223
4.9.2 根據功能號計算內核例程的線性地址 223
4.9.3 快速系統調用的返回和指令前綴REX 225
4.10 利用實時時鐘中斷執行任務切換 226
4.10.1 查找處於就緒狀態的任務 226
4.10.2 任務切換的執行過程 227
4.11 外殼任務的執行過程 229
4.11.1 通過系統調用獲取屏幕上可用的顯示行坐標 229
4.11.2 通過系統調用獲取當前時間 230
4.11.3 在外殼任務中顯示當前時間 231
4.12 用戶任務的創建和執行 232
4.12.1 當前任務標識的獲取 233
4.12.2 用戶程序例程庫的介紹 233
4.12.3 將64位二進制數轉換為十進制字符串 234
4.12.4 在每輪相加中將結果和加數轉換為字符串 235
4.12.5 字符串的連接和顯示 236
4.12.6 用戶任務的終止 236
4.13 本章程序的編譯和執行 238
第5章 多處理器和APIC的初始化 240
5.1 多處理器環境概述 240
5.2 同時多線程和INTEL超線程技術 241
5.3 高級可編程中斷控制器APIC 243
5.3.1 中斷引腳、中斷類型和中斷源 245
5.3.2 本地中斷源和本地向量表 246
5.3.3 APIC的工作模式和APIC ID 247
5.3.4 組成Local APIC ID的處理器拓撲 248
5.3.5 Local APIC的地址映射 249
5.3.6 I/O APIC的地址映射 250
5.3.7 多處理器的初始化過程和MP規範 251
5.3.8 高級的配置和電源接口(ACPI)規範 252
5.4 本章代碼清單 252
5.5 獲取ACPI申領的物理內存地址範圍 271
5.5.1 ACPI的數據結構和表 271
5.5.2 E820功能調用和內存地址範圍結構 272
5.5.3 查詢和保存物理地址映射數據 272
5.5.4 準備映射ACPI申領的內存 274
5.5.5 映射ACPI申領的內存 275
5.6 訪問ACPI的數據結構和表 277
5.6.1 根系統描述指針結構 277
5.6.2 搜索根系統描述指針結構 278
5.6.3 系統描述表的層次結構和表頭格式 278
5.6.4 擴展的系統描述表XSDT 280
5.6.5 通過XSDT搜索多APIC描述表MADT 281
5.6.6 根系統描述表RSDT 282
5.6.7 通過RSDT搜索多APIC描述表MADT 283
5.6.8 多APIC描述表MADT的格式 284
5.6.9 準備遍歷中斷控制器結構列表 286
5.6.10 從中斷控制器結構內提取處理器和APIC信息 287
5.7 映射APIC地址 288
5.8 測量Local APIC定時器 289
5.8.1 Local APIC定時器 290
5.8.2 Local APIC定時器的精度 290
5.8.3 APIC定時器的本地向量表寄存器及其設置 291
5.8.4 設置CMOS RTC以測量Local APIC定時器 292
5.8.5 測量Local APIC定時器在1ms內經歷的時鐘周期數 294
5.9 使用Local APIC定時器中斷切換任務 295
5.9.1 多處理器系統的虛擬線模式 295
5.9.2 中斷輸入引腳LINT0的本地向量表寄存器 296
5.9.3 設置Local APIC定時器 298
5.10 使用經由I/O APIC的中斷執行任務切換 299
5.10.1 I/O APIC概述 300
5.10.2 I/O APIC的I/O重定向表寄存器 302
5.10.3 用I/O APIC投遞的中斷實施任務切換 303
5.11 邏輯目標模式下的中斷目標判別機制 304
5.12 APIC中斷的優先級及其相關的寄存器 305
5.13 APIC中斷的接受機制 306
5.14 最低優先級模式的中斷處理 307
第6章 多處理器環境下的多任務管理和調度 308
6.1 本章代碼清單 309
6.2 高 速 緩 存 338
6.3 數據競爭和鎖 339
6.3.1 單處理器環境下的數據競爭 340
6.3.2 多處理器環境下的數據競爭 342
6.3.3 原子操作 343
6.3.4 鎖和自旋鎖 345
6.3.5 分支預測和PAUSE指令 347
6.3.6 多行宏定義 348
6.3.7 鎖在內核例程中的應用 350
6.3.8 互斥鎖的一般原理 352
6.4 內核的初始化 353
6.4.1 處理器專屬存儲區(每CPU數據區) 354
6.4.2 為自舉處理器BSP分配專屬存儲區 355
6.4.3 處理器專屬存儲區的訪問 356
6.5 多處理器系統的初始化 358
6.5.1 多處理器系統的初始化協議算法 358
6.5.2 本章的多處理器多任務調度方案 360
6.5.3 中斷命令寄存器ICR 362
6.5.4 本章的AP初始化代碼簡介 363
6.5.5 將AP初始化代碼傳送到指定位置 364
6.5.6 向所有應用處理器廣播SIPI消息 365
6.6 應用處理器AP的初始化過程 366
6.6.1 進入保護模式 366
6.6.2 進入64位模式 367
6.6.3 為每個應用處理器創建必要的數據結構 369
6.6.4 對稱多處理器系統的實現 370
6.6.5 用SWAPGS指令訪問專屬存儲區 371
6.6.6 開啟Local APIC並進入停機待命狀態 373
6.7 由自舉處理器BSP繼續完成剩餘的內核初始化工作 374
6.7.1 等待所有應用處理器完成初始化 374
6.7.2 創建系統外殼任務並為其指定時間片 375
6.7.3 廣播新任務認領消息並進入預定狀態 376
6.8 多處理器多任務的管理和調度 377
6.8.1 新任務認領中斷的處理過程 377
6.8.2 在任務鏈表中查找就緒任務 379
6.8.3 用CMPXCHG指令以無鎖方式操作鏈表節點 381
6.8.4 為新任務指定時間片 382
6.8.5 恢復任務的狀態並開始執行 383
6.8.6 時間片到期中斷的處理過程 384
6.8.7 處理器專屬存儲區的必要性 385
6.8.8 外殼任務的執行流程 387
6.8.9 用戶任務的執行流程 388
6.8.10 任務的終止 388
6.9 程序的編譯和執行 389
第7章 多處理器環境下的多線程管理和調度 391
7.1 任務(進程)和線程 391
7.2 本章代碼清單 392
7.3 本章的任務控制塊PCB和線程控制塊TCB 426
7.4 任務及其主線程的創建 429
7.5 線程的調度和切換 431
7.5.1 新線程認領中斷的處理過程 431
7.5.2 查找處於就緒狀態的線程 432
7.5.3 恢復並執行指定的線程 434
7.5.4 時間片到期中斷的處理過程 435
7.6 系統外殼任務及其主線程的執行 436
7.7 將例程創建為線程 437
7.7.1 將例程創建為線程 437
7.7.2 創建線程控制塊TCB和線程私有的棧 438
7.7.3 例程返回和結束線程的區別 439
7.7.4 如何用RET指令結束線程 440
7.7.5 在棧中構造結束線程的棧幀 441
7.7.6 將TCB添加到當前任務的TCB鏈表 442
7.8 線程的執行 443
7.8.1 動態內存分配 444
7.8.2 在棧中保存所有緩沖區的線性地址 444
7.8.3 字符串的生成、連接和打印 446
7.9 線程的結束和任務的終止 447
7.10 程序的編譯和執行 448
第8章 數據競爭和互斥鎖 450
8.1 本章代碼清單 450
8.2 線程的休眠和喚醒 510
8.2.1 執行線程休眠的系統調用 510
8.2.2 保存和修改休眠線程的狀態 512
8.2.3 安裝系統管理中斷 514
8.2.4 系統管理中斷的處理過程 515
8.2.5 喚醒休眠的線程 516
8.3 數據競爭的實例 516
8.3.1 在兩個同時執行的線程內訪問共享數據 517
8.3.2 線程等待 519
8.3.3 喚醒處於等待狀態的線程 520
8.3.4 打印兩個線程操作之後的共享數據 520
8.3.5 並發線程的數據競爭過程 522
8.4 使用鎖定的原子操作解決數據競爭 523
8.5 使用互斥鎖解決數據競爭 525
8.5.1 互斥鎖的創建和初始化 525
8.5.2 互斥鎖的獲取(加鎖) 525
8.5.3 喚醒等待互斥鎖的線程 526
8.5.4 互斥鎖的釋放 527
8.5.5 使用互斥鎖之後的運行效果 527
8.6 互斥鎖的應用策略 528